fpga教程，研究生期間怎么學(xué)習(xí)FPGA

來(lái)源：整理時(shí)間：2023-08-29 02:19:35 編輯：智能門(mén)戶手機(jī)版

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1，研究生期間怎么學(xué)習(xí)FPGA
2，關(guān)于FPGA的學(xué)習(xí)方法
3，怎樣學(xué)習(xí)FPGA 學(xué)習(xí)使用VERILOG 編程實(shí)現(xiàn)簡(jiǎn)答的VGA游戲如
4，如何將程序加載到FPGA
5，專輯fpga引腳分配FPGA的引腳如何配置
6，F(xiàn)PGA怎么開(kāi)始學(xué)

1，研究生期間怎么學(xué)習(xí)FPGA

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研究生期間怎么學(xué)習(xí)FPGA

2，關(guān)于FPGA的學(xué)習(xí)方法

FPGA學(xué)習(xí)過(guò)程和單片機(jī)、ARM不一樣的學(xué)習(xí)FPGA可以遵循以下：數(shù)字電路-》Verilog 語(yǔ)言-》數(shù)字集成電路設(shè)計(jì)-》FPGA設(shè)計(jì)

關(guān)于FPGA的學(xué)習(xí)方法

3，怎樣學(xué)習(xí)FPGA 學(xué)習(xí)使用VERILOG 編程實(shí)現(xiàn)簡(jiǎn)答的VGA游戲如

首先學(xué)習(xí)最簡(jiǎn)單的，基礎(chǔ)學(xué)習(xí)，然后去看一下VGA控制時(shí)序，然后去實(shí)現(xiàn)就可以了，打磚塊游戲就是控制顯示的問(wèn)題，需要做一圖形，然后存儲(chǔ)，根據(jù)當(dāng)前的XY坐標(biāo)來(lái)判斷是不是顯示，這樣子就可以了。

怎樣學(xué)習(xí)FPGA 學(xué)習(xí)使用VERILOG 編程實(shí)現(xiàn)簡(jiǎn)答的VGA游戲如

4，如何將程序加載到FPGA

先準(zhǔn)備下載線和FPGA測(cè)試板。打開(kāi)QuartusII軟件。按下右上角紅箭頭指向的按鈕，顯示下面界面。把下載線插入電腦USB接口，按下左上角Hardware Setup...按鈕，顯示下面界面。這時(shí)通過(guò)按下拉按鈕來(lái)選擇USB-Blaster[USB-0],再按下右邊的ADD Hardware..來(lái)添加下載驅(qū)動(dòng)，添加完下面白框里就有USB-Blaster項(xiàng)顯示。按下上面的Mode下拉按鈕選擇Active Serial Programming,再按下左邊的ADD File..按鈕，顯示下面界面。選擇要下載的pof后綴文件，按下右下角的打開(kāi)按鈕，下載文件被打開(kāi)，顯示界面如下，在Progrom/Configure下面打上勾。8把下載線的另一頭接到FPGA測(cè)試板十芯下載插座上并通電。9按下左邊的Start按鈕就開(kāi)始下載了，等到右上角Progress顯示百分之百就算下載完成了。

5，專輯fpga引腳分配FPGA的引腳如何配置

IO standard是根據(jù)你所要輸入的電平來(lái)設(shè)置，Group是根據(jù)所分配的信號(hào)端口自動(dòng)確定，而每個(gè)引腳的IO Bank本身已經(jīng)確定！一一回答，從簡(jiǎn)單到復(fù)雜。首先說(shuō)IO standard：這個(gè)是用于支持對(duì)應(yīng)不同的電平標(biāo)準(zhǔn)。FPGA IO口的電壓由IO bank上的VCC引入。一個(gè)bank上引入3.3V TTL電平，那么此時(shí)整個(gè)bank上輸出3.3V的TTL電平。設(shè)置這個(gè)第一是為了和current strength一起計(jì)算功率。第二個(gè)是用于在IO口上加載正確的上拉/下拉電阻。只要你設(shè)置完成，Quartus會(huì)按照你的電平標(biāo)準(zhǔn)自動(dòng)布線。第二是IO Bank：你在quartus pin planner 的top view下右鍵然后點(diǎn)擊 show IO banks，這個(gè)時(shí)候就會(huì)看到FPGA的管腳被幾種顏色劃分開(kāi)了。一種顏色下的IO口代表一組bank。你在吧管腳的location約束完成以后。IO Bank會(huì)自動(dòng)填充完畢的。第三是Group：Group就是你所輸出的信號(hào)的名字啦。比如你有一組信號(hào)叫cnt。你對(duì)cnt的某一根賦值，那么。。這里的Group會(huì)自動(dòng)填充為cnt 。第四是Reserved：這個(gè)是對(duì)管腳內(nèi)部的IO邏輯進(jìn)行約束的，你在下面可以看到一些值。介紹幾個(gè)吧。bidrectional：雙向，tri-state:三態(tài)等等。這個(gè)約束的是FPGA在IO端的輸入輸出區(qū)域的邏輯。比如你選擇tri-state。那么這個(gè)時(shí)候，在你IO口前部的IO區(qū)，quartus會(huì)自動(dòng)給你生成一個(gè)三態(tài)門(mén)。第五個(gè)是Vref Group：這個(gè)Group是bank內(nèi)部的細(xì)分區(qū)域，因?yàn)橐粋€(gè)bank可能多達(dá)60個(gè)腳。為了快速定位，你可以利用這個(gè)vref group來(lái)找到某個(gè)管腳。（這個(gè)是非修改屬性）無(wú)法修改。你的理解是正確的，另外，跨越IO bank的信號(hào)沒(méi)有問(wèn)題。只是注意跨bank的電平是否一致即可。對(duì)于跨IO bank的延遲對(duì)于FPGA而言沒(méi)有多少延遲。管腳分配呢，你可以看一下quartus里面pin planner內(nèi)部那張 top view對(duì)于每個(gè)管腳的說(shuō)明。大多數(shù)管腳是可以當(dāng)做普通IO使用的。只是有些特殊要求的時(shí)候。只可以使用對(duì)應(yīng)的IO，比如差分輸入，高時(shí)鐘輸入等等。這個(gè)是要參照對(duì)應(yīng)器件的IO 手冊(cè)來(lái)決定的。而且對(duì)應(yīng)的設(shè)計(jì)大多數(shù)的器件生產(chǎn)商都會(huì)給出參考設(shè)計(jì)。里面包括了IO的設(shè)計(jì)，pcb的設(shè)計(jì)以及內(nèi)部程序端口的約束。所以具體問(wèn)題具體分析。

6，F(xiàn)PGA怎么開(kāi)始學(xué)

學(xué)習(xí)步驟：1，計(jì)算機(jī)必不可少。可以選擇安裝quartusII或者ISE軟件。這是必備的軟件環(huán)境。2、熟悉verilog語(yǔ)言或者vhdl語(yǔ)言，熟練使用quartusII或者ISE軟件。3、設(shè)計(jì)一個(gè)小代碼，下載到目標(biāo)板看看結(jié)果。4、設(shè)計(jì)稍微復(fù)雜的代碼，下載到目標(biāo)板看看結(jié)果。5、設(shè)計(jì)復(fù)雜的代碼，下載到目標(biāo)板看看結(jié)果。6、設(shè)計(jì)高速接口，譬如ddr2或者高速串行接口7、設(shè)計(jì)一個(gè)復(fù)雜的協(xié)議，譬如USB、PCIexpress、圖像編解碼等。8、學(xué)習(xí)再學(xué)習(xí)，知道“學(xué)無(wú)止境，山外有山”。注意事項(xiàng)：第一步：學(xué)習(xí)了解FPGA結(jié)構(gòu)，F(xiàn)PGA到底是什么東西，芯片里面有什么，不要開(kāi)始就拿個(gè)開(kāi)發(fā)板照著別人的東西去編程。第二步：掌握FPGA設(shè)計(jì)的流程。了解每一步在做什么，為什么要那么做。第三步：開(kāi)始學(xué)習(xí)代碼了。不要一開(kāi)始就走入誤區(qū)。第四步：template很重要。能不能高效利用FPGA資源，一是了解fpga結(jié)構(gòu)，二是了解欲實(shí)現(xiàn)的邏輯功能和基本機(jī)構(gòu)，三是使用正確的模板?？偨Y(jié)：理解時(shí)序，邏輯是一拍一拍的東西，在設(shè)計(jì)初期想的不是很清楚的時(shí)候可以畫(huà)畫(huà)時(shí)序圖，這樣思路會(huì)更加的清晰，還有就是仿真很重要，不要寫(xiě)完程序就去往FPGA中去加載，首先要仿真，尤其是對(duì)比較大型一點(diǎn)的程序，想像自己是在做asic，是沒(méi)有二次機(jī)會(huì)的，所以一定要把仿真做好。

最好先看書(shū)，熟悉一下語(yǔ)法。其實(shí)跟C語(yǔ)言差不多，看個(gè)一周就可以簡(jiǎn)單編寫(xiě)小程序，例如：時(shí)鐘分頻、計(jì)數(shù)器、狀態(tài)機(jī)什么的?？赡艿脑挘唾I(mǎi)塊開(kāi)發(fā)板，在上面跑些程序。

語(yǔ)言都是工具，都是其次，重要的是先把數(shù)字電路搞明白，F(xiàn)PGA就是個(gè)可編程的數(shù)字電路，數(shù)字電路明白了后邊也是輕車(chē)熟路了

fpga論壇里有專門(mén)的帖子 fpgaw.com 夏宇聞老師談fpga學(xué)習(xí)整理 1. 必須清楚自己究竟適合不適合做工程師，看看自己的性格特點(diǎn)，是不是特別安靜，又耐得住寂寞，因?yàn)閒pga工程師是一個(gè)很辛苦的工作,要不斷地通過(guò)學(xué)習(xí)研究提升自己的設(shè)計(jì)水平,而且工程師需要經(jīng)常性的熬夜加班敲寫(xiě)代碼,如果沒(méi)有一種耐得住寂寞的性格,fpga工程師最好你不要去做.他不像作銷售那樣，動(dòng)動(dòng)嘴皮子就可以掙到大錢(qián)，fpga工程師在初級(jí)階段薪水也不會(huì)很高，但當(dāng)你有了一定的工程經(jīng)驗(yàn)和項(xiàng)目經(jīng)驗(yàn)的時(shí)候，你的薪水自然就很很高了。所以做fpga工程師首要的一點(diǎn)，必須有一顆耐得住寂寞的心。 2. 如果你認(rèn)為你是一個(gè)可以安靜下來(lái)的人，那接下來(lái)就是要和機(jī)器打交道了。你必須就像熱愛(ài)打游戲一樣熱愛(ài)verilog，每個(gè)想學(xué)fpga的人你可以看看，把自己關(guān)在一個(gè)屋子里，除了吃飯睡覺(jué)外連續(xù)3天的時(shí)間就和verilog為伍，看看大家有沒(méi)有這個(gè)定力，如果你沒(méi)有這個(gè)定力，那么你耐不住寂寞，那好你趕快去找你喜歡做的職業(yè)，如果你還行，那就開(kāi)始艱苦的學(xué)習(xí)。 3. 建立操作環(huán)境，你必須想方設(shè)法安裝了要用到的modelsim，ise，quartusii等操作軟件，最好去網(wǎng)上下載，一次不行就兩次，直到安裝完成，因?yàn)樵绞悄悴蝗菀装惭b上去，你就越珍惜，你就越可以很負(fù)責(zé)任的學(xué)習(xí)。接下來(lái)就對(duì)照相關(guān)的教程熟悉各種軟件，做各種小實(shí)驗(yàn)。 4. 接下來(lái)，可以找著verilog書(shū)自己看看，只要在校的大學(xué)生都可以看得懂，然后很認(rèn)真地作后面的各種練習(xí)。一開(kāi)始簡(jiǎn)單一點(diǎn)，當(dāng)你可以獨(dú)立的把i2c，cpu寫(xiě)出來(lái)的時(shí)候，那個(gè)時(shí)候就可以掙點(diǎn)小錢(qián)了，當(dāng)然接下來(lái)還需要更多的提升和發(fā)展。 5. 對(duì)于我的書(shū)里的一些錯(cuò)誤，很多讀者來(lái)信反映，是因?yàn)槲业碾娮痈迨莣ord，而出版用的是方正的飛騰，轉(zhuǎn)換的時(shí)候會(huì)遇到一些問(wèn)題。如果大家有什么小的項(xiàng)目，跟著學(xué)一學(xué)，還是會(huì)慢慢的成長(zhǎng)起來(lái)。總之，fpga工程師，是一個(gè)看起來(lái)是高薪，又非常艱苦的職業(yè)，如果你的性格適合做這一行，那就付出艱苦努力吧。（整理自北京至芯fpga培訓(xùn)中心開(kāi)學(xué)典禮）

他們說(shuō)得都對(duì)，其實(shí)那個(gè)問(wèn)題開(kāi)始入手都可以，總之所有這些問(wèn)題最后你都得弄懂。實(shí)際上，需要弄懂還遠(yuǎn)不止這些，比如FPGA的datasheet了，就這個(gè)spec有的FPGA就多達(dá)幾百頁(yè)；FPGA設(shè)計(jì)流程，包括：綜合、PAR、timing、constraint等；設(shè)計(jì)FPGA的時(shí)候，還會(huì)有電路圖的設(shè)計(jì)，你得掌握電路圖設(shè)計(jì)工具，至少得會(huì)用，以及如何設(shè)計(jì)合理的FPGA能work的電路圖；FPGA板還可能會(huì)出問(wèn)題，你還得會(huì)調(diào)試，那得學(xué)會(huì)使用儀器，比如示波器、邏輯分析儀等。當(dāng)然前面幾個(gè)說(shuō)，語(yǔ)言是基礎(chǔ)，必須掌握；實(shí)際上，F(xiàn)PGA仿真也是蠻要知識(shí)，你得學(xué)會(huì)寫(xiě)testbench、仿真工具、查看波形、debug等。別急，慢慢來(lái)。

先選定語(yǔ)言最好是VERILOG 再看看參考書(shū)和網(wǎng)上的視頻特權(quán)同學(xué)的還不錯(cuò) 最好要弄塊實(shí)驗(yàn)板沒(méi)有DE系列的可以買(mǎi)特權(quán)視頻里面說(shuō)的那種實(shí)驗(yàn)板這些都是語(yǔ)言工具最重要的是面對(duì)一些問(wèn)題的時(shí)候能有設(shè)計(jì)方案就是所謂的解決方案之后再利用工具實(shí)現(xiàn)功能

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