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pll鎖相環(huán)，pll鎖相環(huán)是怎么工作的

來源：整理 時間：2023-08-23 02:11:55 編輯：智能門戶 手機(jī)版

本文目錄一覽

1，pll鎖相環(huán)是怎么工作的

簡單來說，鑒相器+控制器+反饋環(huán)節(jié)，鑒相器有多種，控制器一般采用PI，如果想仔細(xì)學(xué)習(xí)，買書吧

pll鎖相環(huán)是怎么工作的

2，您好想問一下鎖相環(huán)pll該如何使用

PLL-鎖相環(huán)，是收音機(jī)和通訊接收機(jī)的一種接收技術(shù)電路，它的作用是進(jìn)行頻率綜合，使接收的信號更加精確穩(wěn)定，一般在高端的收音機(jī)和要求較高的通訊接收機(jī)的電路中廣泛使用。

您好想問一下鎖相環(huán)pll該如何使用

3，PLL鎖相環(huán)的怎樣認(rèn)識

鎖相環(huán)用于FPGA主要是倍頻，就是把輸入的時鐘，比如說20M，倍頻到100M，200M，一般FPGA都有鎖相環(huán)內(nèi)核，直接調(diào)用即可，要注意有些PLL的輸入時鐘的管腳必須接到全局時鐘管腳上
pll有很多用途，簡單的是倍頻、分頻，常見的應(yīng)用是頻率跟蹤、抖動濾除。還有比較麻煩的相位控制（就是利用鎖相的基本原理，保證本地時鐘相位/也可以說是時間點，與參考完全一致）。另外還有從數(shù)據(jù)碼流中恢復(fù)時鐘，也經(jīng)常用到鎖相環(huán)。

PLL鎖相環(huán)的怎樣認(rèn)識

4，什么是PLL鎖相環(huán)是怎么一回事謝謝

PLL鎖相環(huán) 一般由鑒相器 壓控振蕩器 環(huán)路通過鑒相器 將振蕩器的頻率鎖定在輸入信號上 最后通過環(huán)路濾波器濾波輸出鎖定后的時鐘鑒相器的作用是鑒別振蕩器的時鐘與輸入信號的時鐘 產(chǎn)生電壓控制信號 控制壓控振蕩器 以產(chǎn)生對應(yīng)的頻率----------------------------------------------------上述為模擬鎖相環(huán)的思路 數(shù)字鎖相環(huán)略有不同..
所謂PLL就是Phase locked loop, 就是相位鎖定環(huán)路．這個主要是用于電子技術(shù)的高頻電子線路上，比較專業(yè)的東西．
pll有很多用途，簡單的是倍頻、分頻，常見的應(yīng)用是頻率跟蹤、抖動濾除。還有比較麻煩的相位控制（就是利用鎖相的基本原理，保證本地時鐘相位/也可以說是時間點，與參考完全一致）。另外還有從數(shù)據(jù)碼流中恢復(fù)時鐘，也經(jīng)常用到鎖相環(huán)。

5，PLL和DLL都是鎖相環(huán)區(qū)別在哪里

DLL是基于數(shù)字抽樣方式，在輸入時鐘和反饋時鐘之間插入延遲，使輸入時鐘和反饋時鐘的上升沿一致來實現(xiàn)的。又稱數(shù)字鎖相環(huán)。PLL使用了電壓控制延遲，用VCO來實現(xiàn)和DLL中類試的延遲功能。又稱模擬鎖相環(huán)。功能上都可以實現(xiàn)倍頻、分頻、占空比調(diào)整，但是PLL調(diào)節(jié)范圍更大，比如說：XILINX使用DLL，只能夠2、4倍頻；ALTERA的PLL可以實現(xiàn)的倍頻范圍就更大畢竟一個是模擬的、一個是數(shù)字的。兩者之間的對比：對于PLL，用的晶振存在不穩(wěn)定性，而且會累加相位錯誤，而DLL在這點上做的好一些，抗噪聲的能力強(qiáng)些；但PLL在時鐘的綜合方面做得更好些。總的來說PLL的應(yīng)用多,DLL則在jitterpower precision等方面優(yōu)于PLL。目前大多數(shù)FPGA廠商都在FPGA內(nèi)部集成了硬的DLL（Delay-Locked Loop）或者PLL（Phase-Locked Loop），用以完成時鐘的高精度、低抖動的倍頻、分頻、占空比調(diào)整移相等。目前高端FPGA產(chǎn)品集成的DLL和PLL資源越來越豐富，功能越來越復(fù)雜，精度越來越高（一般在ps的數(shù)量級）。Xilinx芯片主要集成的是DLL，而Altera芯片集成的是PLL。Xilinx芯片DLL的模塊名稱為CLKDLL，在高端FPGA中，CLKDLL的增強(qiáng)型模塊為DCM（Digital Clock Manager）。Altera芯片的PLL模塊也分為增強(qiáng)型PLL（Enhanced PLL）和高速（Fast PLL）等。這些時鐘模塊的生成和配置方法一般分為兩種，一種是在HDL代碼和原理圖中直接實例化，另一種方法是在IP核生成器中配置相關(guān)參數(shù)，自動生成IP。Xilinx的IP核生成器叫Core Generator，另外在Xilinx ISE 5.x版本中通過Archetecture Wizard生成DCM模塊。Altera的IP核生成器叫做MegaWizard。另外可以通過在綜合、實現(xiàn)步驟的約束文件中編寫約束屬性完成時鐘模塊的約束。
雖然我很聰明，但這么說真的難到我了

6，PLL鎖相環(huán)工作原理是

鎖相環(huán)路是一種反饋電路，鎖相環(huán)的英文全稱是Phase-Locked Loop,簡稱PLL。其作用是使得電路上的時鐘和某一外部時鐘的相位同步。因鎖相環(huán)可以實現(xiàn)輸出信號頻率對輸入信號頻率的自動跟蹤，所以鎖相環(huán)通常用于閉環(huán)跟蹤電路。鎖相環(huán)在工作的過程中，當(dāng)輸出信號的頻率與輸入信號的頻率相等時，輸出電壓與輸入電壓保持固定的相位差值，即輸出電壓與輸入電壓 的相位被鎖住，這就是鎖相環(huán)名稱的由來 在數(shù)據(jù)采集系統(tǒng)中，鎖相環(huán)是一種非常有用的同步技術(shù)，因為通過鎖相環(huán)，可以使得不同的數(shù)據(jù)采集板卡共享同一個采樣時鐘。因此，所有板卡上各自的本地 80MHz和20MHz時基的相位都是同步的，從而采樣時鐘也是同步的。因為每塊板卡的采樣時鐘都是同步的，所以都能嚴(yán)格地在同一時刻進(jìn)行數(shù)據(jù)采集。鎖相環(huán)路是一個相位反饋自動控制系統(tǒng)。它由以下三個基本部件組成：鑒相器（PD）、環(huán)路濾波器（LPF）和壓控振蕩器（VCO）。 鎖相環(huán)的工作原理： 1. 壓控振蕩器的輸出經(jīng)過采集并分頻； 2. 和基準(zhǔn)信號同時輸入鑒相器； 3. 鑒相器通過比較上述兩個信號的頻率差，然后輸出一個直流脈沖電壓； 4. 控制VCO，使它的頻率改變； 5. 這樣經(jīng)過一個很短的時間，VCO 的輸出就會穩(wěn)定于某一期望值。 鎖相環(huán)可用來實現(xiàn)輸出和輸入兩個信號之間的相位同步。當(dāng)沒有基準(zhǔn)（參考）輸入信號時，環(huán)路濾波器的輸出為零（或為某一固定值）。這時，壓控振蕩器按其固有頻率fv進(jìn)行自由振蕩。當(dāng)有頻率為fR的參考信號輸入時，uR 和uv同時加到鑒相器進(jìn)行鑒相。如果fR和fv相差不大，鑒相器對uR和uv進(jìn)行鑒相的結(jié)果，輸出一個與uR和uv的相位差成正比的誤差電壓ud，再經(jīng)過環(huán)路濾波器濾去ud中的高頻成分，輸出一個控制電壓uc，uc將使壓控振蕩器的頻率fv（和相位）發(fā)生變化，朝著參考輸入信號的頻率靠攏，最后使fv= fR，環(huán)路鎖定。環(huán)路一旦進(jìn)入鎖定狀態(tài)后，壓控振蕩器的輸出信號與環(huán)路的輸入信號（參考信號）之間只有一個固定的穩(wěn)態(tài)相位差，而沒有頻差存在。這時我們就稱環(huán)路已被鎖定。 環(huán)路的鎖定狀態(tài)是對輸入信號的頻率和相位不變而言的，若環(huán)路輸入的是頻率和相位不斷變化的信號，而且環(huán)路能使壓控振蕩器的頻率和相位不斷地跟蹤輸入信號的頻率和相位變化，則這時環(huán)路所處的狀態(tài)稱為跟蹤狀態(tài)。
文章TAG：pll鎖相環(huán)pll鎖相環(huán)是怎么工作的

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