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下拉電阻，上拉電阻和下拉電阻有什么區(qū)別

來(lái)源：整理 時(shí)間：2023-08-28 08:01:10 編輯：智能門(mén)戶 手機(jī)版

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1，上拉電阻和下拉電阻有什么區(qū)別

上拉是把電位拉高，因此接電源；下拉是把電位拉低，所以接地。
上拉電阻是串接電阻后接高電平，目的是把該點(diǎn)的電壓拉高下拉電阻是串接電阻后接地，目的是把該點(diǎn)的電壓拉低

上拉電阻和下拉電阻有什么區(qū)別

2，上拉電阻和下拉電阻怎么工作的

上、下拉電阻在數(shù)字電路中常常用到，作用就是提高電路的穩(wěn)定性。使高低電平作用明顯。
⑵下拉電阻或排阻（一端接信號(hào)線，另一端接地） 作用:對(duì)信號(hào)進(jìn)行預(yù)處理，起到濾波作用，使信號(hào)達(dá)到設(shè)計(jì)時(shí)的理想狀態(tài)

上拉電阻和下拉電阻怎么工作的

3，上拉電阻和下拉電阻是什么意思

電路中上拉電阻與下拉電阻的含義
一、上拉電阻：將一個(gè)不確定的信號(hào)，通過(guò)一個(gè)電阻與電源VCC相連，固定在高電平。作用：上拉是對(duì)器件注入電流；灌電流；當(dāng)一個(gè)接有上拉電阻的IO端口設(shè)置為輸入狀態(tài)時(shí)，它的常態(tài)為高電平。二、下拉電阻：將一個(gè)不確定的信號(hào)，通過(guò)一個(gè)電阻與地GND相連，固定在低電平。作用：下拉是從器件輸出電流；拉電流。當(dāng)一個(gè)接有下拉電阻的IO端口設(shè)置為輸入狀態(tài)時(shí)，它的常態(tài)為低電平。上拉電阻和下拉電阻2者共同的作用是：避免電壓的“懸浮”，造成電路的不穩(wěn)定。

上拉電阻和下拉電阻是什么意思

4，mcu中下拉電阻做什么用

下拉電阻：和上拉電阻的原理差不多， 只是拉到GND去而已。 那樣電平就會(huì)被拉低。 下拉電阻一般用于設(shè)定低電平或者是阻抗匹配(抗回波干擾)。 上拉是對(duì)器件注入電流，下拉是輸出電流； 下拉能和開(kāi)漏配合使用嗎，可能沒(méi)說(shuō)清楚，一般針對(duì)MCU的懸空引腳，我們習(xí)慣做法就是找開(kāi)上拉或下接電阻，讓其引腳有一個(gè)固定的電位，防干擾補(bǔ)充：大部分MCU都內(nèi)部有上,下拉電阻，具體的就型號(hào)來(lái)定，廠家都有說(shuō)明，上，下拉電阻本身阻值都比較大，只為了給引腳一個(gè)固定的電位，對(duì)電流沒(méi)有要求，樓主理解干擾有問(wèn)題，如果引腳沒(méi)有固定的電位，引腳懸空，當(dāng)有干擾信號(hào)時(shí)，引腳就有可能出現(xiàn)高或低的現(xiàn)象。

5，上拉電阻 下拉電阻

上拉電阻和下拉電阻，一般對(duì)于TTL電平來(lái)說(shuō)，上啦電阻就是接5V，下拉電阻接地。作用是，簡(jiǎn)單舉一個(gè)例子，比如cpu的看門(mén)狗復(fù)位是低電平有效。為了保證正常工作時(shí)復(fù)位信號(hào)為高，就需要接一個(gè)上拉電阻，把復(fù)位信號(hào)連到5V，這樣，不復(fù)位的時(shí)候，復(fù)位信號(hào)為高，復(fù)位的時(shí)候，輸出就是低。主要是保證電平狀態(tài)。如果你不接，懸空的話，不輸出的時(shí)候你不能保證電平的高低狀態(tài)
上拉，就是把電位拉高，比如拉到vcc下拉，就是把電壓拉低，拉到gnd一般就是剛上電的時(shí)候，端口電壓不穩(wěn)定，為了讓他穩(wěn)定為高或低，就會(huì)用到上拉或下拉電阻。 有些芯片內(nèi)部集成了上拉電阻，所以外部就不用上拉電阻了。但是有一些開(kāi)漏的，外部必須加上拉電阻。
上拉電阻高電平 下拉電阻低電平
根據(jù)某電路要求輸出電平的狀態(tài)，高電平設(shè)上拉電阻，低電平設(shè)下拉電阻。

6，下拉電阻是什么意思

下拉電阻是串接電阻后接地，目的是把該點(diǎn)的電壓拉低..也可以說(shuō)可以提高端口的灌電流能力。需要用到上拉電阻和下拉電阻的情況還蠻多的， 畫(huà)圖比較麻煩。 上拉電阻：就是從電源高電平引出的電阻接到輸出 1，如果電平用OC(集電極開(kāi)路，TTL)或OD(漏極開(kāi)路，COMS)輸出，那么不用上拉電阻是不能工作的， 這個(gè)很容易理解，管子沒(méi)有電源就不能輸出高電平了。 2，如果輸出電流比較大，輸出的電平就會(huì)降低（電路中已經(jīng)有了一個(gè)上拉電阻，但是電阻太大，壓降太高），就可以用上拉電阻提供電流分量， 把電平“拉高”。（就是并一個(gè)電阻在IC內(nèi)部的上拉電阻上， 讓它的壓降小一點(diǎn)）。當(dāng)然管子按需要該工作在線性范圍的上拉電阻不能太小。當(dāng)然也會(huì)用這個(gè)方式來(lái)實(shí)現(xiàn)門(mén)電路電平的匹配。 需要注意的是，上拉電阻太大會(huì)引起輸出電平的延遲。（RC延時(shí)） 一般CMOS門(mén)電路輸出不能給它懸空，都是接上拉電阻設(shè)定成高電平。 下拉電阻：和上拉電阻的原理差不多， 只是拉到GND去而已。 那樣電平就會(huì)被拉低。 下拉電阻一般用于設(shè)定低電平或者是阻抗匹配(抗回波干擾)。
一、上拉電阻：將一個(gè)不確定的信號(hào)，通過(guò)一個(gè)電阻與電源vcc相連，固定在高電平。作用：上拉是對(duì)器件注入電流；灌電流；當(dāng)一個(gè)接有上拉電阻的io端口設(shè)置為輸入狀態(tài)時(shí)，它的常態(tài)為高電平。二、下拉電阻：將一個(gè)不確定的信號(hào)，通過(guò)一個(gè)電阻與地gnd相連，固定在低電平。作用：下拉是從器件輸出電流；拉電流。當(dāng)一個(gè)接有下拉電阻的io端口設(shè)置為輸入狀態(tài)時(shí)，它的常態(tài)為低電平。上拉電阻和下拉電阻2者共同的作用是：避免電壓的“懸浮”，造成電路的不穩(wěn)定。
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