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am335x,am335xevmsk 預(yù)置cpu主頻是多少

來源:整理 時間:2023-09-02 17:46:46 編輯:智能門戶 手機版

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1,am335xevmsk 預(yù)置cpu主頻是多少

1 AM335x處理器主頻: 720 MHz2 本款cpu屬于開發(fā)板使用對于cpu主頻與性能要求不高
同問。。。

am335xevmsk 預(yù)置cpu主頻是多少

2,弱弱的問一下AM335X的編譯器是硬浮點的還是軟浮點的

AM335X是ARM V7架構(gòu),采用硬浮點。需用帶gnueabihf的編譯器編譯系統(tǒng),hf即hardware float。
我不會~~~但還是要微笑~~~:)

弱弱的問一下AM335X的編譯器是硬浮點的還是軟浮點的

3,AM335X s3c2440 哪個更好

不是一個級別的東西。 AM335X 性能方面強很多。
我也正在學(xué)習(xí)2440,其實什么開發(fā)板都一樣,買到手里,看你怎么學(xué)了。個人建議,你買一個jlink仿真器

AM335X s3c2440 哪個更好

4,AM35XX與AM335X區(qū)別大嗎

前面的AM35XX是指貨號是AM35的兩個加大號碼,而AM335X則是指貨號為AM335的一個加大碼,區(qū)別不就出來了?貨物不一樣號碼也不一樣。
沒看懂什么意思?

5,AM335X開發(fā)板的介紹

AM335X是TI(德州儀器)基于 ARM Cortex-A8內(nèi)核的AM335X微處理器在圖像、圖形處理、外設(shè)和諸如 EtherCAT 和 PROFIBUS 的工業(yè)接口選項方面進行了增強。
ti 335x處理器的lcd控制器驅(qū)動是非常完善的,共通的地方已經(jīng)由驅(qū)動封裝好了,如果我們想進行l(wèi)cd的配置,我應(yīng)該通過dts配置完成lcd的顯示。下面,我們來討論下使用dts方式配置內(nèi)核完成lcd驅(qū)動的思路?! ?1)初步分析  由于tq335x使用的芯片是am335x,故仍然可以參考am335x-evm.dts。當(dāng)然,am335x-evmsk.dts、am335x-beagbone.dts都可以。本文以am335x-evm.dts為例。大體上瀏覽下dts文件,可以發(fā)現(xiàn)兩個醒目的節(jié)點:一個是panel,一個是backlight。接下來我們逐個分析?! ?2)panel節(jié)點信息分析及配置  從panel節(jié)點可以獲得如下信息:1. 匹配內(nèi)核驅(qū)動的關(guān)鍵詞是:"ti,tilcdc,panel",可以通過這個關(guān)鍵字找到相應(yīng)的驅(qū)動。 2. 管腳配置在節(jié)點lcd_pins_s0內(nèi) 3. panel-info中可以配置lcd的硬件信息,如lcd的分辨率等 4. display-times中記錄了lcd刷屏的相關(guān)時序。   其中,panel-info和display-times需要去lcd手冊中查找,管腳配置需要根據(jù)am335x的芯片手冊、數(shù)據(jù)手冊及tq335x的原理圖確定,驅(qū)動則需要去內(nèi)核的driver目錄下查找。下面,我一一解決上述幾個問題:  首先是設(shè)置panel-info和display-times。我的tq335x是用的我調(diào)試tq210時使用的觸摸屏,型號是tn92,這個屏是800*480的分辨率,因此,panel-info與evm開發(fā)板的配置是相同的,可以不做任何修改。但是,不同屏幕的display-times一般是不相同的,因此,需要查閱觸摸屏的手冊來確認(rèn)display-times。

6,AM335X DDR 三 調(diào)試總結(jié)怎么解決

1. 剛開始調(diào)試的時候按照TI FAE 給的文檔調(diào)試 DDR3(文檔名:DDR3 Software Leveling and Registers Configuration.pdf 作者:garry) 但是一直有問題,卡在了用CCS5 運行 DDR3_slave_ratio_search_auto.out 這個軟件的時候 老是進入了死循環(huán)2. 繼續(xù)找資料,最后在github 上找到了一個用DDR3例子3. 移植例子,系統(tǒng)起來以下是我移植的代碼:#define DDR3_EMIF_READ_LATENCY 0x100006 /* Enable Dynamic Power Down */#define DDR3_EMIF_TIM1 0x0888A39B#define DDR3_EMIF_TIM2 0x26337FDA#define DDR3_EMIF_TIM3 0x501F830F#define DDR3_EMIF_SDCFG 0x61C04AB2#define DDR3_EMIF_SDREF 0x0000093B#define DDR3_ZQ_CFG 0x50074BE4#define DDR3_DLL_LOCK_DIFF 0x1#define DDR3_RATIO 0x40#define DDR3_INVERT_CLKOUT 0x1#define DDR3_RD_DQS 0x3B#define DDR3_WR_DQS 0x85#define DDR3_PHY_WR_DATA 0xC1#define DDR3_PHY_FIFO_WE 0x100#define DDR3_IOCTRL_VALUE 0x18B/* Micron ???? on 1.5 and later EVMs */#define DDR3_EMIF_TIM2_EVM 0x26517FDA#define DDR3_EMIF_TIM3_EVM 0x501F851F#define DDR3_RD_DQS_EVM 0x3A#define DDR3_WR_DQS_EVM 0x0CD#define DDR3_PHY_FIFO_WE_EVM 0x10B#define DDR3_PHY_WR_DATA_EVM 0x106#define DATA1_RD_DQS_SLAVE_RATIO_0 (DDR_PHY_BASE_ADDR + 0x16C)#define EMIF0_0_ZQ_CONFIG (EMIF4_0_CFG_BASE + 0xC8)#define DATA1_WR_DQS_SLAVE_RATIO_0 (DDR_PHY_BASE_ADDR + 0x180)#define DATA1_FIFO_WE_SLAVE_RATIO_0 (DDR_PHY_BASE_ADDR + 0x1AC)#define DATA1_WR_DATA_SLAVE_RATIO_0 (DDR_PHY_BASE_ADDR + 0x1C4)#define MDDR_SEL_DDR2 0xefffffff /* IOs set for DDR2-STL Mode */#define CKE_NORMAL_OP 0x00000001 /* Normal Op:CKE controlled by EMIF */static void config_emif_ddr3(void) /*Program EMIF0 CFG Registers*/ writel(DDR3_EMIF_READ_LATENCY, EMIF4_0_DDR_PHY_CTRL_1); writel(DDR3_EMIF_READ_LATENCY, EMIF4_0_DDR_PHY_CTRL_1_SHADOW); writel(DDR3_EMIF_READ_LATENCY, EMIF4_0_DDR_PHY_CTRL_2); writel(DDR3_EMIF_TIM1, EMIF4_0_SDRAM_TIM_1); writel(DDR3_EMIF_TIM1, EMIF4_0_SDRAM_TIM_1_SHADOW); writel(DDR3_EMIF_TIM2, EMIF4_0_SDRAM_TIM_2); writel(DDR3_EMIF_TIM2, EMIF4_0_SDRAM_TIM_2_SHADOW); writel(DDR3_EMIF_TIM3, EMIF4_0_SDRAM_TIM_3); writel(DDR3_EMIF_TIM3, EMIF4_0_SDRAM_TIM_3_SHADOW);writel(DDR3_EMIF_SDREF, EMIF4_0_SDRAM_REF_CTRL); writel(DDR3_EMIF_SDREF, EMIF4_0_SDRAM_REF_CTRL_SHADOW); writel(DDR3_ZQ_CFG, EMIF0_0_ZQ_CONFIG); writel(DDR3_EMIF_SDCFG, EMIF4_0_SDRAM_CONFIG); }#ifndef PRCM_MOD_EN#define PRCM_MOD_EN 0x2#endifvoid enable_ddr3_clocks(void) /* Enable the EMIF_FW Functional clock */ writel(PRCM_MOD_EN, CM_PER_EMIF_FW_CLKCTRL); /* Enable EMIF0 Clock */ writel(PRCM_MOD_EN, CM_PER_EMIF_CLKCTRL); /* Poll if module is functional */ while ((readl(CM_PER_EMIF_CLKCTRL)) != PRCM_MOD_EN);}static void phy_config_cmd(void) writel(DDR3_RATIO, CMD0_CTRL_SLAVE_RATIO_0); writel(DDR3_INVERT_CLKOUT, CMD0_INVERT_CLKOUT_0); writel(DDR3_RATIO, CMD1_CTRL_SLAVE_RATIO_0); writel(DDR3_INVERT_CLKOUT, CMD1_INVERT_CLKOUT_0); writel(DDR3_RATIO, CMD2_CTRL_SLAVE_RATIO_0); writel(DDR3_INVERT_CLKOUT, CMD2_INVERT_CLKOUT_0);}static void phy_config_data(void) writel(DDR3_RD_DQS, DATA0_RD_DQS_SLAVE_RATIO_0); writel(DDR3_WR_DQS, DATA0_WR_DQS_SLAVE_RATIO_0); writel(DDR3_PHY_FIFO_WE, DATA0_FIFO_WE_SLAVE_RATIO_0); writel(DDR3_PHY_WR_DATA, DATA0_WR_DATA_SLAVE_RATIO_0); writel(DDR3_RD_DQS, DATA1_RD_DQS_SLAVE_RATIO_0); writel(DDR3_WR_DQS, DATA1_WR_DQS_SLAVE_RATIO_0); writel(DDR3_PHY_FIFO_WE, DATA1_FIFO_WE_SLAVE_RATIO_0); writel(DDR3_PHY_WR_DATA, DATA1_WR_DATA_SLAVE_RATIO_0);}static void config_am335x_ddr3(void) enable_ddr3_clocks(); config_vtp(); phy_config_cmd(); phy_config_data(); /* set IO control registers */ writel(DDR3_IOCTRL_VALUE, DDR_CMD0_IOCTRL); writel(DDR3_IOCTRL_VALUE, DDR_CMD1_IOCTRL); writel(DDR3_IOCTRL_VALUE, DDR_CMD2_IOCTRL); writel(DDR3_IOCTRL_VALUE, DDR_DATA0_IOCTRL); writel(DDR3_IOCTRL_VALUE, DDR_DATA1_IOCTRL); /* IOs set for DDR3 */ writel(readl(DDR_IO_CTRL) & MDDR_SEL_DDR2, DDR_IO_CTRL); /* CKE controlled by EMIF/DDR_PHY */ writel(readl(DDR_CKE_CTRL) | CKE_NORMAL_OP, DDR_CKE_CTRL); config_emif_ddr3();}
文章TAG:am335xam335xevmsk預(yù)置cpu主頻是多少

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