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1，modelsim仿真
2，modelsim有什么優(yōu)點(diǎn)為什么要用它仿真
3，modelsim怎么對(duì)網(wǎng)表進(jìn)行仿真
4，Modelsim仿真方法前仿真和后仿真的區(qū)別
5，如何對(duì)多個(gè)文件進(jìn)行MODELSIM仿真
6，multisim和modelsim有什么區(qū)別

1，modelsim仿真

前仿真和后仿真。前是對(duì)邏輯功能的仿真。后仿真是加入延時(shí)的仿真，也就是實(shí)際芯片運(yùn)行時(shí)的工作狀態(tài)。

modelsim仿真

2，modelsim有什么優(yōu)點(diǎn)為什么要用它仿真

modelsim是專業(yè)的仿真軟件，其操作簡(jiǎn)單，仿真運(yùn)行速度比同類的其他仿真軟件都要快很多。并且它支持GUI和dos命令雙重操作，對(duì)linux系統(tǒng)也是適用的。

modelsim有什么優(yōu)點(diǎn)為什么要用它仿真

3，modelsim怎么對(duì)網(wǎng)表進(jìn)行仿真

step1：在qurtus改變編譯選項(xiàng)： assignments－>EDA tool setting:選擇verilog還是vhdl。 step2：編譯。你會(huì)在你的工程所在目錄看到一個(gè)simulation的目錄，這里面有你生成的網(wǎng)表文件和標(biāo)準(zhǔn)延時(shí)文件。 step3：在目錄：\quartus\eda\sim_lib找到你...

modelsim怎么對(duì)網(wǎng)表進(jìn)行仿真

4，Modelsim仿真方法前仿真和后仿真的區(qū)別

前仿真是功能仿真，不帶時(shí)延的仿真。后仿真是帶時(shí)延的仿真。一般做FPGA設(shè)計(jì)，只要進(jìn)行前仿真即可，后仿真要做的事情，由寫給FPGA的時(shí)序約束文件來(lái)保證。后仿真一般芯片設(shè)計(jì)的時(shí)候用的多些。

我用你的程序仿真出來(lái)了,正確的,有波形啊. 我想你是不是應(yīng)該把testbench也就是testsim.v和sim.v一起編譯,然后在library你的編譯后的兩個(gè)文件一起選中然后右鍵選擇simulate,再在sim標(biāo)簽里面把testsim右鍵選擇add to wave,最后run all就ok了,如果還不行qq上聯(lián)系吧..我演示給你看= =|||(因?yàn)槲也皇嵌?jí)用戶..所以沒有辦法上傳圖片)

5，如何對(duì)多個(gè)文件進(jìn)行MODELSIM仿真

可以將所有要編譯的所有文件的名字做一個(gè)list。新建一個(gè)文本文檔，重命名為vflist vflist內(nèi)容例子如下(src為文件夾)： src/base_addr_chk.v src/config_mux.v src/glue.v src/pargen.v src/pci_top.v src/retry_count.v src/state_machine.v tstbench/bkend_daemon.v tstbench/pci_clk_reset.v tstbench/pci_stim.v tstbench/pci_tb.v 在modelsim中編譯的時(shí)候可使用如下命令 vlog -f vflist 或者將此命令寫在do文件里如果只有幾個(gè)文件要編譯，也可以使用命令vlog a1.v b2.v c3.v

6，multisim和modelsim有什么區(qū)別

　　Multisim是加拿大圖像交互技術(shù)公司（Interactive Image Technoligics簡(jiǎn)稱IIT公司)推出的以Windows為基礎(chǔ)的仿真工具，適用于板級(jí)的模擬/數(shù)字電路板的設(shè)計(jì)工作。它包含了電路原理圖的圖形輸入、電路硬件描述語(yǔ)言輸入方式，具有豐富的仿真分析能力。　　工程師們可以使用Multisim交互式地搭建電路原理圖，并對(duì)電路行為進(jìn)行仿真。Multisim提煉了SPICE仿真的復(fù)雜內(nèi)容，這樣工程師無(wú)需懂得深入的SPICE技術(shù)就可以很快地進(jìn)行捕獲、仿真和分析新的設(shè)計(jì)，這也使其更適合電子學(xué)教育。通過Multisim和虛擬儀器技術(shù)，PCB設(shè)計(jì)工程師和電子學(xué)教育工作者可以完成從理論到原理圖捕獲與仿真再到原型設(shè)計(jì)和測(cè)試這樣一個(gè)完整的綜合設(shè)計(jì)流程。　　Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語(yǔ)言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺(tái)無(wú)關(guān)，便于保護(hù)IP核，個(gè)性化的圖形界面和用戶接口，為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。　　主要特點(diǎn)：　　? RTL和門級(jí)優(yōu)化，本地編譯結(jié)構(gòu)，編譯仿真速度快，跨平臺(tái)跨版本仿真；　　? 單內(nèi)核VHDL和Verilog混合仿真；　　? 源代碼模版和助手，項(xiàng)目管理；　　? 集成了性能分析、波形比較、代碼覆蓋、數(shù)據(jù)流ChaseX、Signal Spy、虛擬對(duì)象Virtual Object、Memory窗口、Assertion窗口、源碼窗口顯示信號(hào)值、信號(hào)條件斷點(diǎn)等眾多調(diào)試功能；　　? C和Tcl/Tk接口，C調(diào)試；　　? 對(duì)SystemC的直接支持，和HDL任意混合　　? 支持SystemVerilog的設(shè)計(jì)功能；　　? 對(duì)系統(tǒng)級(jí)描述語(yǔ)言的最全面支持，SystemVerilog, SystemC, PSL; 　　? ASIC Sign off。