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噪聲容限，什么影響噪聲容限

來源：整理 時間：2023-09-02 00:26:36 編輯：智能門戶 手機(jī)版

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1，什么影響噪聲容限

這個跟 設(shè)備 可以識別信號的靈敏度有關(guān)。

什么影響噪聲容限

2，噪聲容限低怎么解決

同意樓上的，先換個測試貓試試看，如果還掉，再考慮線路。線路上有問題，聽電話音就能知道大概，有除電流音外的雜音肯定線路質(zhì)量差，線路檢查一段一段檢查，有ADSL測試儀更好，沒有就麻煩些，
寫下今天最想說的

噪聲容限低怎么解決

3，噪聲容限的基本概述

噪聲容限（英語：Noise Margin）是指在前一極輸出為最壞的情況下，為保證后一極正常工作，所允許的最大噪聲幅度 。在數(shù)字電路中，一般常以“1”態(tài)下（上）限噪聲容限和“0”態(tài)上（下）限噪聲容限中的最小值來表示電路（或元件）的噪聲容限。噪聲容限越大說明容許的噪聲越大，電路的抗干擾性越好。高電平噪聲容限=最小輸出高電平電壓-最小輸入高電平電壓低電平噪聲容限=最大輸入低電平電壓-最大輸出低電平電壓噪聲容限=min

噪聲容限的基本概述

4，邏輯門電路高電平噪聲容限的物理意義是

電子技術(shù)書籍中對數(shù)字電路部分邏輯門高電平噪聲容限有有如下定義：能夠被判斷為邏輯1時的最小輸入電壓與邏輯1對應(yīng)的理想電壓之間的差值，低噪聲容限類似。實際上也就是指的抗干擾水平。
ttl電平： 輸出高電平>2.4v,輸出低電平<0.4v。在室溫下，一般輸出高電平是3.5v，輸出低電平是0.2v。最小輸入高電平和低電平：輸入高電平>=2.0v，輸入低電平<=0.8v，噪聲容限是0.4v。

5，請問什么叫噪聲容限還有74HC系列和74LS系列

74代表民用 LS代表TTL電路的一個系列，TTL電路以雙極型晶體管為開關(guān)元件所以以稱雙極型集成電路。 HC代表CMOS電路，以絕緣柵場效應(yīng)晶體管為開關(guān)元件。所以又稱單極型集成電路。 基本是通用，74HCXX的功能與74LSXX相同，XX代表它的登記型號，不同型號代表不同的IC,就是說，例如，74HC00＝74LS00，只不過IC用的制作方法不同，都是4雙輸入NAND電路,74HC系列消耗比74LS系列要低，通?，F(xiàn)在用74HC系列多些

6，哪位高手解釋一下噪聲容限

在前一極輸出為最壞的情況下,為保證后一極正常工作.所允許的最大噪聲幅度. 噪聲容限(DSL) 噪聲容限(也稱SNR邊際)是DSL針對噪音的信號比率的相對力量。 6dB是最低的dB通常制造指定為了調(diào)制解調(diào)器能對synch。 在某些情況下插入可能幫助培養(yǎng)噪聲容限到一個可接受水平。 一般來說，當(dāng)整體帶寬增加，您的針對噪音的信號比率減少。 升級從1.5到6.0的顧客將典型地看在針對噪音的信號比率的對應(yīng)的減退。 這是正常和沒什么憂慮。 越高數(shù)字好這次測量的。 下列是不同的噪聲容限價值和他們的對DSL連接的作用的比較。 6dB以下不是壞的，并且有synch或斷斷續(xù)續(xù)的synch問題 7dB-10dB是公平的，但是不把變化的室留在情況 11dB-20dB是好沒有synch問題 20dB-28dB是優(yōu)秀的 29dB以上是卓著的 在通信系統(tǒng)工程學(xué)，噪聲容限是信號超出極小的可接受的數(shù)額的比率。 它在分貝耳通常被測量。 在一條數(shù)字電路，噪聲容限是信號超出一適當(dāng)0或1的門限的數(shù)額。 例如，一條數(shù)字電路也許被設(shè)計搖擺在0.0和1.2伏特之間，與任何東西在0.2伏特以下考慮了一0，并且任何在1.0伏特之上考慮了一1。 然后0的噪聲容限是數(shù)額信號在0.2伏特以下，并且1的噪聲容限是信號超出1.0伏特的數(shù)額。 在這種情況下噪聲容限沒有被測量作為絕對電壓，沒有比率。 CMOS芯片的噪聲容限比TTL通常偉大，因為VOH分鐘是離電源電壓較近，并且最大卷是離零較近。 噪聲容限通常被定義，以便正面價值保證正確的操作，或許，并且消極邊際導(dǎo)致減弱的操作或者徹底失敗。
我這些天也遇到很多報修，設(shè)備都是有滋滋聲高頻音，然后現(xiàn)象就是同步不穩(wěn)定或者不同步，一個設(shè)備進(jìn)去留意看了下，容限只有9.換了一個modem上去就好了。我個人建議還是換一個設(shè)備吧。參考見此帖 <a target="_blank">http://www.chinadsl.net/redirect.php?tid=46493&amp;goto=lastpost#lastpost</a>
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