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黑科技智能鐘表系統(tǒng)有哪些，多功能桌面時(shí)鐘

來(lái)源：整理時(shí)間：2023-05-14 11:00:50 編輯：智能門(mén)戶(hù) 手機(jī)版

1，多功能桌面時(shí)鐘

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果果桌面?；蚴囚~(yú)魚(yú)桌面。。都是要可以的。。不過(guò)不建議裝。。除非你的電腦性能好。。。很占用CPU資源的。。呵呵。。

多功能桌面時(shí)鐘

2，電子實(shí)時(shí)時(shí)鐘萬(wàn)年日歷系統(tǒng)

[摘要]：本設(shè)計(jì)論文介紹了用at89c2051單片機(jī)控制的數(shù)字鐘的硬件結(jié)構(gòu)與軟件設(shè)計(jì),給出了匯編語(yǔ)言源程序。此數(shù)字鐘是一個(gè)將“時(shí)”、“分”、“秒”“百分秒”顯示于人的視覺(jué)器官的計(jì)時(shí)裝置。它的計(jì)時(shí)周期為12小時(shí)，顯示滿(mǎn)刻度為12時(shí)59分59秒99毫秒，另外應(yīng)有校時(shí)功電路由時(shí)鐘脈沖發(fā)生器、時(shí)鐘計(jì)數(shù)器、譯碼驅(qū)動(dòng)電路和數(shù)字顯示電路以及時(shí)間調(diào)整電路組成。一、晶體振蕩器用晶體振蕩器產(chǎn)生時(shí)間標(biāo)準(zhǔn)信號(hào)，這里采用石英晶體振蕩器二、計(jì)數(shù)器根據(jù)60秒為1分、60分為1小時(shí)、12小時(shí)為1天的計(jì)數(shù)周期，分別組成一個(gè)100制（百分秒）、兩個(gè)60進(jìn)制（秒、分）、一個(gè)12進(jìn)制（時(shí)）的計(jì)數(shù)器。構(gòu)成百分秒、秒、分、時(shí)的計(jì)數(shù)，實(shí)現(xiàn)計(jì)時(shí)的功能。三、驅(qū)動(dòng)和數(shù)碼顯示電路顯示器件選用LED七段數(shù)碼管。在譯碼顯示電路輸出的驅(qū)動(dòng)下，顯示出清晰、直觀(guān)的數(shù)字符號(hào)。四、校時(shí)電路針對(duì)數(shù)字鐘會(huì)產(chǎn)生走時(shí)誤差的現(xiàn)象，在電路中就設(shè)計(jì)有有校準(zhǔn)時(shí)間功能的電路。[關(guān)鍵詞]：?jiǎn)纹瑱C(jī) AT89C2051 數(shù)字鐘計(jì)時(shí)不知道你要的是不是這個(gè)東西，如果不是我可以給你改，包括電路制作，聯(lián)系我加我，看我名字上的數(shù)字

pic16f877a 萬(wàn)年歷 1.本數(shù)字始時(shí)鐘可以顯示日期，時(shí)間，并具有農(nóng)歷與星期查詢(xún)功能 2.具有環(huán)境溫度檢測(cè)功能。 3.三組鬧鐘設(shè)置。使用方法： 1.使用"設(shè)置"鍵可以方便切換要設(shè)置的對(duì)象，并配合+、-鍵使之設(shè)置成你要的數(shù)值。 2.當(dāng)設(shè)置鬧鐘時(shí)，當(dāng)調(diào)到想要設(shè)置的時(shí)間時(shí)，按存儲(chǔ)鍵即可存入第一組鬧鐘，以此類(lèi)推共可以設(shè)置三組。參考鏈接： http://www.picavr.com/news/2009-11/1675.htm 萬(wàn)年歷算法全集參考鏈接： http://www.51dz.com/0/n---13123--.htm

電子實(shí)時(shí)時(shí)鐘萬(wàn)年日歷系統(tǒng)

3，在verilog數(shù)字系統(tǒng)中有哪幾種系統(tǒng)時(shí)鐘

一、各輸入、輸出信號(hào)引腳說(shuō)明：CLK：時(shí)鐘信號(hào)RST：系統(tǒng)復(fù)位信號(hào)，低電平有效。時(shí)鐘復(fù)位后為：00 00 00。EN：暫停信號(hào)，低電平有效，按下該鍵，數(shù)字時(shí)鐘暫停。S1：調(diào)節(jié)小時(shí)信號(hào)，低電平有效。每按下一次，小時(shí)增加一個(gè)小時(shí)。S2：調(diào)節(jié)分鐘信號(hào)，低電平有效。每按下一次，分鐘增加一個(gè)分鐘。skp：輸出到揚(yáng)聲器，在每個(gè)小時(shí)的59分50秒到0分10秒之間將會(huì)產(chǎn)生報(bào)警聲音。HOURH,HOURL,MINH,MINL,SECH,SECL：分別對(duì)應(yīng)小時(shí)、分鐘、秒鐘的十位和個(gè)位。二、 Verilog HDL編寫(xiě)的數(shù)字時(shí)鐘程序：module clock(CLK,RST,EN,S1,S2,spk,HOURH,HOURL,MINH,MINL,SECH,SECL);input CLK,RST,EN,S1,S2;output spk;output[3:0] HOURH,HOURL,MINH,MINL,SECH,SECL;reg spk;reg[3:0] SECL,SECH,MINL,MINH,HOURL,HOURH; always @(posedge CLK or negedge RST) if(!RST) begin SECL<=0;SECH<=0;MINL<=0;MINH<=0;HOURL<=0;HOURH<=0; end //系統(tǒng)復(fù)位 else if(EN) //EN為低電平時(shí)時(shí)鐘暫停 begin if(!S1) //調(diào)節(jié)小時(shí) begin if(HOURL==9) begin HOURL<=0; HOURH<=HOURH+1; end else begin if(HOURH==2&&HOURL==3) begin HOURL<=0;HOURH<=0; end else HOURL<=HOURL+1; end end else if(!S2) //調(diào)節(jié)分鐘 begin if(MINL==9) begin MINL<=0; if(MINH==5) MINH<=0; else MINH<=MINH+1; end else MINL<=MINL+1; end else if(SECL==9) //時(shí)鐘正常跳動(dòng)狀態(tài) begin SECL<=0; if(SECH==5) begin SECH<=0; if(MINL==9) begin MINL<=0; if(MINH==5) begin MINH<=0; if(HOURL==9) begin HOURL<=0;HOURH<=HOURH+1;end else if(HOURH==2&&HOURL==3) begin HOURL<=0; HOURH<=0;end else HOURL<=HOURL+1; end else MINH<=MINH+1; end else MINL<=MINL+1; end else SECH<=SECH+1; end else SECL<=SECL+1; end else begin HOURH<=HOURH; HOURL<=HOURL; MINH<=MINH; MINL<=MINL; SECH<=SECH; SECL<=SECL; end always @(posedge CLK) //產(chǎn)生報(bào)警聲音模塊 begin if(MINH==5&&MINL==9&&SECH==5) begin spk<=CLK;end else if(MINH==0&&MINL==0&&SECH==0) spk<=CLK; else spk<=0; endendmodule

在module paobiao中把執(zhí)行條件srt=1，在module shizhong中把執(zhí)行條件srt=0;通過(guò)按鍵消抖，當(dāng)按鍵按一下是對(duì)外部srt=~srt執(zhí)行一次。其他的計(jì)時(shí)很容易設(shè)計(jì)。

在verilog數(shù)字系統(tǒng)中有哪幾種系統(tǒng)時(shí)鐘