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FPLA，請(qǐng)問PLA是什么

來源：整理 時(shí)間：2024-08-21 09:28:19 編輯：智能門戶 手機(jī)版

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1，請(qǐng)問PLA是什么

中國人民解放軍的英文簡(jiǎn)稱

請(qǐng)問PLA是什么

2，數(shù)字電路中PLA是什么

可編程邏輯陣列(programmable logic array) 是一種可編程邏輯裝置,它的與陣列(AND array)和或陣列(OR array)均為可編程,輸出電路為不可組態(tài).又叫做FPLA(field-programmable logic array)

數(shù)字電路中PLA是什么

3，nonconform to fair packageing and labeling act什么意

不符合《正確包裝和標(biāo)識(shí)法》 Fair Packaging and Labeling Act 是一項(xiàng)法律 FPLA (Fair Packaging and Labeling Act)公平包裝和標(biāo)簽法 公平包裝和標(biāo)簽法（ fpla或行為） ，于1967年制定，指示聯(lián)邦貿(mào)易委員會(huì)和美國食品和藥物管理局發(fā)出的規(guī)例規(guī)定所有的“消費(fèi)商品”的標(biāo)示披露的凈含量，商品的身份，并將其命名為和營業(yè)地點(diǎn)的該產(chǎn)品的制造商，封隔器，或經(jīng)銷商。 該法授權(quán)的其他規(guī)例在必要時(shí)，以防止消費(fèi)者的欺騙（或以方便值比較）方面的說明材料，填補(bǔ)疲弱的軟件包，使用“美分小康”或更低的價(jià)格標(biāo)簽，或表征封裝尺寸。 辦公室度量衡的國家標(biāo)準(zhǔn)和技術(shù)研究所，美國商業(yè)部，是受權(quán)促進(jìn)，以最大可行的最大范圍內(nèi)的統(tǒng)一性，在州政府和聯(lián)邦政府管理的標(biāo)記消費(fèi)商品。

nonconform to fair packageing and labeling act什么意

4，在數(shù)字電路中PLA的乘積線是什么注意呀不是乘積項(xiàng)答得好的

http://wenku.baidu.com/link?url=sTx9gstvETJdgpxkEkjScSBizXTYoCwkiF66DWShA8m4yOUKgAOd8PYoIE44mAe2nxjsmDNDajUAV7gJAOzGPUfcWyeHJJCaPnYpI1hYTNW11頁，說明的很清楚。乘積線是簡(jiǎn)明畫法，用一根連線與點(diǎn)、叉等符號(hào)表明邏輯門的輸入結(jié)構(gòu)，使電路圖簡(jiǎn)單明了。在計(jì)算機(jī)電路中也是如此，數(shù)據(jù)總線、地址總線沒必要畫十幾根：地址線是單向傳輸，數(shù)據(jù)線是雙向傳輸。
可編程邏輯陣列(programmable logic array) 是一種可編程邏輯裝置,它的與陣列(and array)和或陣列(or array)均為可編程,輸出電路為不可組態(tài).又叫做fpla(field-programmable logic array)

5，EDA技術(shù)與ASIC設(shè)計(jì)和PLDFPGA開發(fā)有什么關(guān)系

就這幾個(gè)概念包括的范圍來說EDA>ASIC>PLD設(shè)計(jì)EDA是電子設(shè)計(jì)自動(dòng)化的概念不過也有把EDA設(shè)計(jì)只等同于PCB設(shè)計(jì)的。ASIC 是定制芯片設(shè)計(jì) 包括前端 后端 和驗(yàn)證 FPGA 設(shè)計(jì)是邏輯設(shè)計(jì) 只做前端 和驗(yàn)證的多，后端做得少。在做ASIC設(shè)計(jì)時(shí)可以把邏輯先做出來，下載到FPGA做硬件驗(yàn)證。
EDA是電子設(shè)計(jì)自動(dòng)化的概念,函義較廣ASIC是專用集成電路，用PLD（Programmable logic Device)通過HDL可以設(shè)計(jì)ASIC，目前廣泛使用的PLD即是FPGA和CPLDASIC 是分定制和可編程ASIC，而可編程ASIC就可以用FPGA和CPLD設(shè)計(jì)出來
eda是電子設(shè)計(jì)自動(dòng)化. asic專用集成電路.pld可編程邏輯器件.fpga現(xiàn)場(chǎng)可編程門陣列. eda技術(shù)就是以計(jì)算機(jī)為工具，設(shè)計(jì)者在eda軟件平臺(tái)上，用硬件描述語言hdl完成設(shè)計(jì)文件，然后由計(jì)算機(jī)自動(dòng)地完成邏輯編譯、化簡(jiǎn)、分割、綜合、優(yōu)化、布局、布線和仿真，直至對(duì)于特定目標(biāo)芯片的適配編譯、邏輯映射和編程下載等工作。并在可編程邏輯器件（如cpld、fpga）的應(yīng)用，已得到廣泛的普及。 在集成電路界asic被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路?，F(xiàn)代asic常包含整個(gè)32-bit處理器,類似rom、ram、eeprom、flash的存儲(chǔ)單元和其他模塊. 這樣的asic常被稱為soc(片上系統(tǒng))。fpga是asic的近親，一般通過原理圖、vhdl對(duì)數(shù)字系統(tǒng)建模，運(yùn)用eda軟件仿真、綜合，生成基于一些標(biāo)準(zhǔn)庫的網(wǎng)絡(luò)表，配置到芯片即可使用。它與asic的區(qū)別是用戶不需要介入芯片的布局布線和工藝問題，而且可以隨時(shí)改變其邏輯功能，使用靈活。 pld是做為一種通用集成電路生產(chǎn)的，他的邏輯功能按照用戶對(duì)器件編程來高定。一般的pld的集成度很高，足以滿足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。目前和平和使用的pld產(chǎn)品主要有：1、現(xiàn)場(chǎng)可編程邏輯陣列fpla;2、可編程陣列邏輯pal;3、通用陣列邏輯gal;4、可擦除的可編程邏輯器件epld ;5、現(xiàn)場(chǎng)可編程門陣列fpga。其中epld和fpga的集成度比較高。有時(shí)又把這兩種器件稱為高密度pld。 那么可以說fpga只是eda,asic,pld的另一種表現(xiàn)方式.它是在pal、gal、cpld等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（asic）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。

6，可編程邏輯器件一般分幾種

一般分為四種：SPLD、CPLD、FPGA及ISP器件
首先分別介紹了FPLA、PAL、GAL、EPLD以及FPGA等各種類型可編程邏輯器件的結(jié)構(gòu)特點(diǎn)、工作原理和使用方法，然后介紹了可編程邏輯器件的編程方法，最后簡(jiǎn)要地介紹了在系統(tǒng)可編程技術(shù)。 1、可編程邏輯器件(PLD)的產(chǎn)生和特點(diǎn) 通用型的中小規(guī)模數(shù)字集成電路的邏輯功能比較簡(jiǎn)單，可以組成任何復(fù)雜的數(shù)字系統(tǒng)，具有很強(qiáng)的通用性；專用集成電路能把所設(shè)計(jì)的數(shù)字系統(tǒng)做成一片大規(guī)模集成電路，它不僅能減小電路的的體積、重量、功耗，而且會(huì)使電路的可靠性大為提高。然而，當(dāng)用量不大時(shí)，設(shè)計(jì)和制造這樣的專用集成電路不僅周期嫌長，成本也很高?？删幊踢壿嬈骷≒LD）可以很好的解決這個(gè)矛盾。PLD是作為一種通用器件生產(chǎn)的，但它的邏輯功能是由用戶通過對(duì)器件編程來設(shè)定的，并可重復(fù)擦寫多次，而且，有些PLD的集成度很高，足以滿足設(shè)計(jì)一般數(shù)字系統(tǒng)的需要。 2、PLD的分類 PLD按集成度（以700門/片為界）可以分為低密度PLD和高密度PLD。低密度PLD主要有現(xiàn)場(chǎng)可編程邏輯陣列FPLA、可編程陣列邏輯PAL和通用陣列邏輯GAL，高密度PLD主要有可擦除的可編程邏輯器件EPLD和現(xiàn)場(chǎng)可編程門陣列FPGA等幾種類型。此外，在上一講存儲(chǔ)器中所介紹的PROM、EPROM、E2PROM皆屬于可編程邏輯器件。 3、PLD的一般結(jié)構(gòu)和開發(fā)系統(tǒng) 一般PLD的基本結(jié)構(gòu)由與陣列、或陣列、輸入電路和輸出電路組成。與陣列和或陣列是電路的主體，主要用來實(shí)現(xiàn)組合邏輯函數(shù)。輸入電路使輸入信號(hào)具有足夠的的驅(qū)動(dòng)能力，并產(chǎn)生互補(bǔ)輸入信號(hào)。輸出電路可以提供不同的輸出方式。此外，輸出端口上往往帶有三態(tài)門，通過三態(tài)門控制數(shù)據(jù)直接輸出或反饋回輸入端。通常PLD電路中只有部分電路可以編程或組態(tài)，PROM、PLA、PAL和GAL四種PLD電路主要是編程情況和輸出結(jié)構(gòu)不同，因而電路結(jié)構(gòu)也不相同，下表中列出了四種PLD 電路的結(jié)構(gòu)特點(diǎn)。 PLD的開發(fā)系統(tǒng)由硬件和軟件兩部分組成。硬件部分包括計(jì)算機(jī)和專門的編程器，軟件部分有各種編程軟件。利用這些開發(fā)系統(tǒng)幾小時(shí)內(nèi)就能完成PLD的編程工作，大大提高了設(shè)計(jì)工作的效率。新一代的在系統(tǒng)可編程（ISP）器件的編程就更加簡(jiǎn)單了，變成時(shí)不需要使用專門的編程器，只要將計(jì)算機(jī)運(yùn)行產(chǎn)生的編程數(shù)據(jù)直接寫入PLD就行了。 4、PLD電路中門電路的慣用畫法 PLD電路中門電路的慣用畫法見P404圖8.1.1 。特別指出，圖中“．”表示固定連接，“×”表示編程連接。 5、現(xiàn)場(chǎng)可編程邏輯陣列FPLA的基本組成以及與ROM的區(qū)別 現(xiàn)場(chǎng)可編程邏輯陣列FPLA由可編程的與邏輯陣列和可編程的或邏輯陣列以及輸出緩沖器組成，如P405圖8.2.1所示。 FPLA與ROM的比較： 1） 電路結(jié)構(gòu)極為相似，都是由一個(gè)與邏輯陣列、一個(gè)或邏輯陣列和輸出緩沖器組成。 2） ROM的與邏輯陣列是固定的，而FPLA 的與邏輯陣列是可編程的。 3） ROM 的與邏輯陣列將輸入變量的全部最小項(xiàng)都譯出了，而FPLA 的與邏輯陣列只產(chǎn)生所需要的少得多的乘積項(xiàng)。 因此，使用FPLA設(shè)計(jì)組合邏輯電路比使用ROM規(guī)模大為縮小，芯片的利用率得到有效的提高。 6、FPLA的使用 1） FPLA的編程單元用輸入變量數(shù)、與邏輯陣列的輸出端數(shù)、或邏輯陣列的輸出端數(shù)三者的乘積表示。 2） FPLA的編程單元有熔絲型和疊柵注入式MOS管兩種，它們的單元結(jié)構(gòu)和PROM、UVEPROM中的存儲(chǔ)單元一樣，編程的原理和方法也相同。 3） FPLA中輸出緩沖器的結(jié)構(gòu)形式是三態(tài)輸出（TS）和集電極開路結(jié)構(gòu)（OC）的。還有一些FPLA器件在或邏輯陣列輸出端與輸出緩沖器之間設(shè)置了可編程的異或門，以便于對(duì)輸出的極性進(jìn)行控制。 4） FPLA電路按是否含有觸發(fā)器可分為組合邏輯型FPLA和時(shí)序邏輯型FPLA。前者只能用于設(shè)計(jì)組合邏輯函數(shù)，而后者可用于設(shè)計(jì)時(shí)序邏輯函數(shù)。 7、FPLA器件使用時(shí)的優(yōu)缺點(diǎn) FPLA的優(yōu)點(diǎn)是體積小，速度快；缺點(diǎn)是編程周期較長，而且是一次性的。 1、PAL的結(jié)構(gòu)特點(diǎn)和應(yīng)用 1.1 PAL的特點(diǎn) PAL器件由可編程的與邏輯陣列、固定的或邏輯陣列和輸出電路三部分組成。它采用雙極型工藝制作，熔絲編程方式。 1.2 PAL的基本電路結(jié)構(gòu) PAL的基本電路結(jié)構(gòu)僅包含一個(gè)可編程的與邏輯陣列和一個(gè)固定的或邏輯陣列，沒有附加其它的輸出電路，是最簡(jiǎn)單的一種電路結(jié)構(gòu)形式。編程前，與邏輯陣列的所有交叉點(diǎn)上均有熔絲接通，編程時(shí)將有用的熔絲保留，將無用的熔絲熔斷，即得到所需的電路。 見P259圖8.11所示。 具體網(wǎng)址： http://netclass.csu.edu.cn/jpkc2008/China/szdzjs/jaoan/sd8.htm
主要有三種 PLD，CPLD，F(xiàn)PGA PLD一般為一次性燒寫 CPLD可多次燒寫，ROM型，掉電不丟失 FPGA可多次燒寫，掉電丟失，每次重啟需要初始化
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